Verilog Gate Instantiation: AND, OR & NOT Gates Explained
0:11
Verilog Gate Instantiation: AND, OR & NOT Gates Explained
8 views1 month ago
YouTubeverilog_code
What Is wreal, and Why Does Verilog-AMS Need It? #eda #cadence #chipdesign
1:00
What Is wreal, and Why Does Verilog-AMS Need It? #eda #cadence #chipdesign
4 views1 month ago
YouTubeCadence Design Systems
Resistor Modeling in Verilog-A #verilog #vlsi
1:13
Resistor Modeling in Verilog-A #verilog #vlsi
654 views2 months ago
YouTubeCadence Design Systems
Verilog for beginners: Understand Operator Precedence easily with Practical Simulation
1:07
Verilog for beginners: Understand Operator Precedence easily with Practical Simulation
17 views1 month ago
YouTubeSuccess Point for VLSI
Verilog wire Explained i | Connecting Signals in Verilog
0:11
Verilog wire Explained i | Connecting Signals in Verilog
104 views1 month ago
YouTubeverilog_code
Build a Half Adder in Verilog Using assign | Verilog Dataflow Modeling
0:11
Build a Half Adder in Verilog Using assign | Verilog Dataflow Modeling
282 views1 month ago
YouTubeverilog_code
Behavioral Modeling in Verilog: The always Block Explained 🔥 | Verilog Tutorial
0:17
Behavioral Modeling in Verilog: The always Block Explained 🔥 | Verilog Tutorial
37 views1 month ago
YouTubeverilog_code
0:18
Build a 4:1 Multiplexer in Verilog using always 🔥 | MUX Explained
46 views1 month ago
YouTubeverilog_code
0:11
The logic Data Type Explained | SystemVerilog’s Upgrade from reg & wire #Shorts
49 views1 month ago
YouTubeverilog_code
0:11
Logical Operators in Verilog: &&, ||, ! Explained #Verilog #VLSI
126 views1 month ago
YouTubeverilog_code
1:24
Difference between Data types of Verilog and SystemVerilog #cadence #chipdesign
1.1K views5 months ago
YouTubeCadence Design Systems
1:07
Digital Versus Analog: Inverter Modeling, Unpacked #vlsi #coding #asicdesign
633 views3 months ago
YouTubeCadence Design Systems
6:39
Học Ngành Vi Mạch Bán Dẫn: Cơ Hội và Thách Thức
104.7K viewsSep 6, 2025
TikTokthayquyethuongnghiep
0:54
LÀM CHIP KHÓ LẮM SAO? LỘ TRÌNH 6 BƯỚC ĐỂ TRỞ THÀNH KỸ SƯ THIẾT KẾ IC! ⸻ 1. Thiết kế IC là gì? \t•\tThiết kế IC (Integrated Circuit) là quá trình biến ý tưởng thành vi mạch điện tử. \t•\tGồm 2 mảng chính: \t•\tFront-end: Thiết kế logic – viết code mô tả phần cứng (Verilog/VHDL). \t•\tBack-end: Triển khai layout – thiết kế hình dạng vật lý con chip. ⸻ 2. Lộ trình học chi tiết – Từng bước thực tế: Bước 1: Nắm chắc kiến thức điện tử cơ bản \t•\tMạch điện – điện tử: Op-amp, logic gates, CMOS, MOSFET.
65.2K viewsApr 25, 2025
TikTokongbobitcoin
0:11
Frequency Divider Explained ⚡ | Divide-by-2, ÷4, ÷8 Using Flip-Flops | Verilog & VLSI #vlsi #shorts
706 views1 week ago
YouTubeverilog_code
0:10
Engineer's Guide to Coding and Electronics for Women in STEM
61.9K viewsSep 14, 2023
TikTokaiszzyelectronics
0:15
FPGA para aplicaciones espaciales
18.2K viewsJun 29, 2025
TikTokcapsula.electronica
3:07
Cuánto ganamos nosotros , los arquitectos en FPGA? #jlcpcb #FPGA #vhdl #fpgaperuana #capsulaelectronica #ingenierofisico #fpgainit #verilog
27.2K viewsMay 30, 2025
TikTokcapsula.electronica
0:12
FPGA Project: 7 Segment LED Display with Verilog
5.9K viewsSep 13, 2025
TikTokfurt_tech
0:35
FPGAs Peruanas: Prototipo Oficial y Entrenamiento
10.7K viewsNov 12, 2024
TikTokcapsula.electronica
See more
Static thumbnail place holder